About The Role

能效目标攻坚与顶层设计直接对芯片整体 power / 能效指标负责，主导制定 GPU/AI 芯片的静态功耗、动态功耗、能效比（TFLOPS/W）等量化目标，并驱动团队达成负责 GPU 芯片 Low Power 顶层架构设计（电源域、时钟方案、功耗状态机、DVFS/AVS 策略等），输出 Low power top spec，并完成技术任务拆解与技术把关
跨团队垂直拉通与技术协同垂直拉通系统软硬件、芯片架构、IP、后端设计等多团队，建立低功耗技术沟通机制，确保低功耗方案在系统级真实落地并发挥实际效应与固件/驱动/操作系统团队协同，定义硬件-软件协同的功耗管理接口（如 P-state、c-state、热管理等），实现从芯片到系统的端到端功耗优化推动架构、前端、后端、验证团队在低功耗设计上的信息对齐与决策闭环，解决因技术孤岛导致的能效损失
低功耗技术发展规划与团队能力提升负责芯片 Low Power 发展整体方向规划，制定 1~3 年技术路线图，对标国际顶尖水平（如 NVIDIA、AMD、Intel 的 GPU 低功耗方案）引入国际先进低功耗技术（如精细粒度电源门控、自适应电压缩放、AI 辅助功耗预测、先进制程低功耗特性等），快速提升公司低功耗设计水平至国际领先提升 Low Power 团队整体技术能力，包括功耗建模、功耗分析、功耗优化、低功耗验证等核心能力建设，培养能打硬仗的低功耗专家梯队
流程建设与设计方法学优化负责芯片 Low Power 新流程建设和现有流程优化，建立覆盖架构评估、RTL 功耗优化、门级功耗签核、硅后功耗校准的全流程功耗管控体系推行标准化的低功耗设计套件（UPF/CPF 规范、功耗分析 checklists、功耗回归流程），提升多项目复用的效率与质量建立功耗数据的度量、归因与跟踪机制，支持每次流片后的能效复盘与持续改进
技术把关与风险管控对 Low Power 相关的关键设计评审、技术决策、signoff 质量进行技术把关识别能效设计中的早期风险（如电源域划分不合理、漏电失控、动态电压降超标等），并推动解决方案落地
微电子、电子工程、计算机科学或相关专业硕士及以上学历，博士优先
工作经验： 10 年以上芯片设计经验，其中 6 年以上低功耗架构或低功耗设计经验 3 年以上技术团队管理经验（10 人以上团队优先） GPU/高性能芯片经验
有 GPU、AI 训练芯片、高性能 SoC 或服务器芯片的低功耗设计并成功量产的经历低功耗技术深度
精通 DVFS、AVS、电源/时钟门控、多电压域、多阈值库、自适应体偏置等主流低功耗技术，并具备在先进工艺（7nm 及以下）的实际落地经验
熟练使用功耗分析优化工具（PowerArtist、PTPX、Prime-Power 等），具备硅前功耗建模与硅后功耗测量/校准的项目经验
深刻理解系统级功耗管理机制（ACPI、P-state、CPPC 等），具备软硬件协同功耗优化能力
领导力与沟通：具备极强的跨团队拉通能力，能驱动架构、设计、软件、系统等多个团队为共同能效目标协同工作技术规划能力：曾主导制定低功耗技术路线，并成功引入外部先进技术（如来自行业领先公司的设计方法学或工具）

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低功耗专家(J10901)

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